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HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計

深山正幸 [ほか] 著. -- 第2版. -- 共立出版, 2002. <BB00106633>
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深山正幸 [ほか] 著. -- 第2版. -- 共立出版, 2002. <BB00106633>
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所蔵一覧 1件～4件（全4件）

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No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 返却予定日 予約 WEB書棚
0001 札　幌 電動和書 549.7/H 0010780356012 配架済 0件
0002 12号館 開架室 549.7/H 0010009395938 配架済 0件
0003 静　岡 開架室 549.7/H 0010042011388 配架済 0件
0004 熊　本 本館２階　書庫 549.7/M 001076125420X 配架済 0件
No. 0001
巻号
所蔵館 札　幌
配置場所 電動和書
請求記号 549.7/H
資料ID 0010780356012
状態 配架済
返却予定日
予約 0件
WEB書棚
No. 0002
巻号
所蔵館 12号館
配置場所 開架室
請求記号 549.7/H
資料ID 0010009395938
状態 配架済
返却予定日
予約 0件
WEB書棚
No. 0003
巻号
所蔵館 静　岡
配置場所 開架室
請求記号 549.7/H
資料ID 0010042011388
状態 配架済
返却予定日
予約 0件
WEB書棚
No. 0004
巻号
所蔵館 熊　本
配置場所 本館２階　書庫
請求記号 549.7/M
資料ID 001076125420X
状態 配架済
返却予定日
予約 0件
WEB書棚
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書誌詳細

標題および責任表示 HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計 / 深山正幸 [ほか] 著
HDL ニ ヨル VLSI セッケイ : Verilog HDL ト VHDL ニヨル CPU セッケイ
版事項 第2版
出版・頒布事項 東京 : 共立出版 , 2002.1
形態事項 x, 245p ; 24cm
巻号情報
ISBN 4320120272
注記 その他の著者: 北川章夫, 秋田純一, 鈴木正國
注記 参考図書: p[241]-242
学情ID BA5517252X
本文言語コード 日本語
著者標目リンク 深山, 正幸(1966-)||ミヤマ, マサユキ <AU00006742>
著者標目リンク 北川, 章夫(1961-)||キタガワ, アキオ <AU00006743>
著者標目リンク 秋田, 純一(1970-)||アキタ, ジュンイチ <AU00006744>
著者標目リンク 鈴木, 正國(1939-)||スズキ, マサクニ <AU00006745>
分類標目 電子工学 NDC8:549.7
分類標目 電子工学 NDC9:549.7
分類標目 科学技術 NDLC:ND386
ローカル分類標目 NDC9:549.7
件名標目等 集積回路||シュウセキカイロ
件名標目等 集積回路||シュウセキカイロ
レコードID BB00106633
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